SVA: The Power of Assertions in SystemVerilog - Eduard Cerny - 書籍 - Springer International Publishing AG - 9783319331096 - 2016年8月23日
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SVA: The Power of Assertions in SystemVerilog Softcover reprint of the original 2nd ed. 2015 edition

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This book is a comprehensive guide to assertion-based verification of hardware designs using System Verilog Assertions (SVA). The book makes SVA usable and accessible for hardware designers, verification engineers, formal verification specialists and EDA tool developers.


609 pages, 173 black & white illustrations, 25 black & white tables, biography

メディア 書籍     Paperback Book   (ソフトカバーで背表紙を接着した本)
リリース済み 2016年8月23日
ISBN13 9783319331096
出版社 Springer International Publishing AG
ページ数 590
寸法 155 × 235 × 31 mm   ·   843 g
言語 ドイツ語  

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